Phương pháp khống chế và kiểm tra chân FPGA dựa trên tiêu chuẩn IEEE 1149.1 và XJLink
Bài viết đề xuất một phương pháp khống chế và kiểm tra khả năng hoạt động của các chân chip FPGA khi đang hoạt động trong hệ thống điện điện tử dựa trên tiêu chuẩn IEEE 1149.1. Phương pháp sử dụng phần cứng XJLink thông qua nhân IP theo kết cấu quét biên tiêu chuẩn IEEE 1149.1 tích hợp bên trong FPGA thực hiện khống chế và gài lỗi trên một số chân của chip để kiểm tra tính năng của các chân đó mà không cần thực hiện các tác động vật lý hay phải tháo dỡ FPGA ra khỏi bo mạch.
Xin lỗi bạn không thể down load tài liệu này. Bạn có thể xem tài liệu trực tuyến trên website hoặc liên hệ thư viện trường để được hướng dẫn. Cảm ơn bạn đã sử dụng dịch vụ của chúng tôi.
Bạn vui lòng tham khảo thỏa thuận sử dụng của thư viện số.